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嵌入式OS-Linux

Linux應(yīng)用開發(fā)班
嵌入式Linux系統(tǒng)開發(fā)班

嵌入式Linux驅(qū)動開發(fā)班
Linux網(wǎng)絡(luò)工程及系統(tǒng)管理
Linux驅(qū)動、系統(tǒng)、應(yīng)用全能班

嵌入式CPU--ARM

ARM開發(fā)培訓(xùn)班

CortexM3+uC/OS培訓(xùn)班

嵌入式OS--WinCE

WinCE應(yīng)用開發(fā)培訓(xùn)班

WinCE系統(tǒng)定制與驅(qū)動班

單片機(jī)培訓(xùn)

單片機(jī)系統(tǒng)開發(fā)初級和中級班

單片機(jī)系統(tǒng)開發(fā)高級班

嵌入式硬件設(shè)計(jì)

高速嵌入式系統(tǒng)硬件設(shè)計(jì)班

Allegro Cadence PCB設(shè)計(jì)初級和中級班

Allegro Cadence PCB設(shè)計(jì)高級班

Power Pcb(PADS)設(shè)計(jì)培訓(xùn)班

Protel培訓(xùn)班

高效開關(guān)電源設(shè)計(jì)與提高班

電路設(shè)計(jì)培訓(xùn)

EMC設(shè)計(jì)高級培訓(xùn)班

PCB Layout培訓(xùn)-線路板設(shè)計(jì)全能班

Altium Designer Layout高速硬件設(shè)計(jì)

Mentor EE 高速電路板設(shè)計(jì)與仿真

Mentor WG 高速電路板設(shè)計(jì)與仿真

模擬電路前端設(shè)計(jì)培訓(xùn)班

電路設(shè)計(jì)全能班

電子電路設(shè)計(jì)高級培訓(xùn)班

芯片設(shè)計(jì)培訓(xùn)班

集成電路（IC）版圖設(shè)計(jì)培訓(xùn)班

RF射頻電路設(shè)計(jì)培訓(xùn)班

數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班

數(shù)字、模擬電路設(shè)計(jì)培訓(xùn)班

SOC設(shè)計(jì)培訓(xùn)班

嵌入式OS--VxWorks

VxWorks應(yīng)用開發(fā)培訓(xùn)班

VxWorks BSP開發(fā)高級班

PowerPC嵌入式系統(tǒng)/編譯器優(yōu)化

PowerPC(PPC)系統(tǒng)開發(fā)培訓(xùn)班

飛思卡爾MPC系統(tǒng)開發(fā)培訓(xùn)班

編譯器原理及優(yōu)化技術(shù)專題班


PLC編程/變頻器/數(shù)控/人機(jī)界面

PLC編程系列培訓(xùn)課程表
變頻器系列培訓(xùn)課程表

人機(jī)界面、數(shù)控系列培訓(xùn)課程表

開發(fā)語言/數(shù)據(jù)庫/軟硬件測試

Java/.NET/C#/SQL全能培訓(xùn)班

Oracle數(shù)據(jù)庫培訓(xùn)

SQL Server數(shù)據(jù)庫培訓(xùn)

軟件測試培訓(xùn)

硬件測試培訓(xùn)

系統(tǒng)構(gòu)架師培訓(xùn)

Delphi程序設(shè)計(jì)班

VB語言培訓(xùn)班(VB.NET)

QNX實(shí)時OS編程培訓(xùn)班

3G手機(jī)軟件測試、硬件測試

3G軟件測試工程師班

嵌入式測試和3G手機(jī)硬件測試班

芯片設(shè)計(jì)/大規(guī)模集成電路VLSI

芯片、集成電路設(shè)計(jì)系列一課程表

芯片、集成電路設(shè)計(jì)系列二課程表

云計(jì)算、物聯(lián)網(wǎng)

云計(jì)算、云安全培訓(xùn)班

物聯(lián)網(wǎng)產(chǎn)業(yè)、核心技術(shù)培訓(xùn)班

開源操作系統(tǒng)Tiny OS開發(fā)

小型機(jī)系統(tǒng)管理

IBM AIX 6 Basics培訓(xùn)班

IBM AIX 6 System II培訓(xùn)班

Solaris 操作系統(tǒng)網(wǎng)絡(luò)管理

HP-Unix系統(tǒng)及網(wǎng)絡(luò)管理

IBM 大型機(jī)操作系統(tǒng)培訓(xùn)班

SolidEdge ST&ST2 實(shí)戰(zhàn)

網(wǎng)絡(luò)安全管理實(shí)戰(zhàn)培訓(xùn)

其他類

長期班

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◆招人、應(yīng)聘、人才合作，請把需求發(fā)到officeoffice@126.com或訪問曙海旗下網(wǎng)站--- 電子人才網(wǎng)： www.morning-sea.com.cn

合作伙伴與授權(quán)機(jī)構(gòu)

現(xiàn)代化的多媒體教室

曙海招聘啟示

最新招聘信息（2011年7月23日）

曙海動態(tài)

第21期MTK培訓(xùn)班完滿結(jié)業(yè)
[2010-4-1]

2009年“寒假培訓(xùn)系列課程”
開始招生[2008-12-31]

曙海嵌入式學(xué)院隆重推出“寒
假培訓(xùn)系列課程”[2007-12-16]

慶祝曙海創(chuàng)立5周年，部分課
程9折回饋學(xué)員[2006-03-12]

為普及嵌入式課程，學(xué)生
報名享受優(yōu)惠[2005-08-03]

曙海嵌入式培訓(xùn)課程全面
升級,啟用2.0版[2004-06-14]

曙海成為Altera公司
全球合作培訓(xùn)機(jī)構(gòu)[2002-10-07]

020321屆Linux驅(qū)動開發(fā)班
學(xué)生圓滿畢業(yè)[2002-04-25]

上海計(jì)算機(jī)技術(shù)協(xié)會頒發(fā)給曙海
高新技術(shù)科技證書[2001-05-19]

郵件列表

　　　　　　　　時序及噪音分析培訓(xùn)班

入學(xué)要求

學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
◆ 電路系統(tǒng)的基本概念。

班級規(guī)模及環(huán)境

為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅(jiān)持小班授課，每期報名人數(shù)限3到5人，多余人員安排到下一期進(jìn)行。

上課時間和地點(diǎn)

上課地點(diǎn)：【上�！浚和瑵�(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山學(xué)院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學(xué)/六宅臻品【鄭州分部】：鄭州大學(xué)/錦華大廈【石家莊分部】：河北科技大學(xué)/瑞景大廈
最近開課時間(周末班/連續(xù)班/晚班）：時序及噪音分析培訓(xùn)班：2025年12月15日..以服務(wù)質(zhì)量為生命....共贏、共創(chuàng)....資深工程師授課.....直播、現(xiàn)場培訓(xùn)皆可....用心服務(wù)..........

學(xué)時

　    ◆請咨詢客服

        ◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學(xué)員免費(fèi)推薦工作

        ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年，曙海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力
        得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

        ★實(shí)驗(yàn)設(shè)備請點(diǎn)擊這兒查看★

最新優(yōu)惠

◆團(tuán)體報名優(yōu)惠措施：請咨詢客服

質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費(fèi)提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會。 ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)。專注高端培訓(xùn)13年，曙海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

　　　　　　　　時序及噪音分析培訓(xùn)班

1. MOS models
1.1 MOS basics
1.2 MOS I-V characteristics
1.3 Interconnect models
1.4 Scaling trends
2. Delay computation
2.1 Cell libraries
2.2 Effective capacitance
2.3 Interconnect delay
2.4 Cell model limitations
3. Static timing analysis
3.1 Topological analysis
3.2 Path enumeration
3.3 BFS vs DFS
3.4 Timing exception
3.5 Clock skew
3.6 Logic analysis
3.7 False path
4. Crosstalk timing analysis
4.1 Spice based models
4.2 Current based models
4.3 Noisy delay computation
4.4 Waveform effects
4.5 Timing window
4.6 Aggressor alignment
4.7 False coupling
5. Process variation
5.1 Process models
5.2 Chip-to-chip variation
5.3 Within chip variation
5.4 Process corners
6. Statistical timing analysis
6.1 Statistical timing analysis vs. static timing analysis
6.2 Method and implementation
6.3 Pron. & Cron.
7. Noise models
7.1 Coupling noise
7.2 Charge sharing
7.3 Leakage
7.4 Power supply noise
8. Static noise analysis
8.1 Noise computation
8.2 Noise immunity
8.3 Noise propagation
8.4 Multiple input noise
8.5 Simultaneous input/output noise
8.6 Noise window
8.7 Probabilistic analysis
9. Silicon timing/noise issues
9.1 Chip failure examples
9.2 Work-out methods to fix problems
10. 10. Signoff methodologies
10.1 Timing/noise signoff flow
10.2 Hierarchical analysis
10.3 Block timing models
10.4 Block noise models
10.5 Tool integration

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